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FPGA设计(工作地:西安)
1.4-2.8万
成都
武侯区
1-3年
本科
全职
招1人
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职位描述
Verilog
RTL设计
电子/半导体/集成电路
IC设计岗位要求:
a. 应熟悉芯片设计开发流程;
b. 具有芯片开发、IP集成,IP验证或FPGA设计开发相关经验;
c. 语言表达能力较强;
d. 具有独立开发需求的能力;
e. 至少具有一年芯片开发相关工作经验
岗位职责:
a.需求捕获工作,设计文档编写工作;
b.与上层需求双向追踪。
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工作地点
成都武侯区天府软件园A区A6,4楼
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谢静/招聘专员
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