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高级fpga工程师
2.5-3.5万
苏州
吴中区
5-10年
本科
全职
招1人
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职位描述
ATE
PCIe
Verilog HDL
时序分析
岗位职责:
1、 参与项目需求分析、方案评估、选型;
2、 负责项目中的FPGA功能设计与实现、仿真,调试、验证;
3、 负责项目开发中的时序,关键问题和难题攻克、BUG定位与修改;
4、 参与产品软硬件联合调试,产品不良分析与功能指标验证,生产与维修指导;
5、 编写设计、生产、维护以及FPGA设计相关文档;(需根据架构师要求,编写芯片data sheet供上层软件驱动开发)
6、 产品现场应用问题支持与对应;
任职要求:
1、 熟练掌握数字电路、模拟电路及数字信号处理等相关知识;
2、 熟练掌握Verilog语言编程,具有优良的代码风格;
3、 熟悉Xilinx Zynq系列、Ultrascale系列 FPGA的使用;熟悉Vivado开发工具和FPGA设计流程;
4、 熟悉以太网、DDR、PCIe、SerDes、I2C、SPI、UART等外设接口及规范;
5、 熟悉高速数字系统,FPGA与DSP、ARM之间的高速通信方式如PCIe、EBI、EMIF通信;熟悉AMBA/AXI等总线协议;有过pattern矢量波形处理经验的优先。
6、 掌握FGPA时序约束、资源复用、布局、布线等技术,(要求对时序约束,时序分析,时序优化有较为深刻的理解,确保输出高时间精度的稳定波形)
7、 熟练掌握一种或多种常用脚本语言(c/tcl/perl/python等);
要求编写过datasheet文档,能根据架构师要求,合理规划地址空间,编写良好的寄存器开发手册,便于上层软件基于此进行驱动开发
工作地点
吴中区联东U谷苏州木渎精密制造产业园
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