更新于 11月19日

FPGA工程师(c5)

1-1.6万
  • 长沙开福区
  • 四方坪
  • 经验不限
  • 硕士
  • 全职
  • 招1人

职位描述

C语言Verilog HDLVHDLModelsimISEVivado
岗位职责
1、负责FPGA总体方案的设计、选型、进行复杂FPGA单元架构设计并编制文档;
2、可独立承担项目FPGA逻辑开发、负责HDL代码设计、仿真及时序优化;
3、与软、硬件工程师协作,进行产品联调、测试;
4、解决产品出现的逻辑缺陷问题;
5、完成领导交予的其它工作。
岗位要求
1、电子/通信/测控等相关专业,要求硕士研究生(含)以上学历;
2、熟练掌握Verilog或VHDL设计语言,熟悉数字逻辑电路设计;
3、精通ISE、Vivado等FPGA开发工具和ChipScope、ModelSim等调试工具;
4、拥护党的路线、方针、政策,思想进步,品德优良,有较强的团队协作和吃苦耐劳精神,适应出差,有较强的组织纪律观念和顾全大局的意识,服从管理,身体健康。
福利待遇
1、具体面议,主要根据学识基础、工作能力和项目情况确定薪资,后续年份根据能力和业绩上调;
2、可根据承担的项目计领任务绩效,项目结题即可发放;
3、试用期三个月,表现突出者可提前转正;
4、购买五险一金。

工作地点

长沙开福区三一大道德雅路口(公交站)

职位发布者

黄蕴瑾/人事

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天津先进技术研究院是滨海新区下属的自收自支事业单位,专门从事电子信息技术及网络信息安全领域研究,位于天津滨海高新区。研究院设立PK体系技术协同创新中心、智能泛在感知协同创新中心等若干技术协同创新平台,并建设测试认证中心、自主可控适配中心等服务平台。孵化成立了飞腾信息、麒麟软件、天津鲲鹏、天津优扬、天津长天科融等公司。研究院以推动科技协同创新为宗旨,以国家战略需求为牵引,瞄准解决国家“卡脖子”核心关键技术,开展产业技术创新与攻关。深耕国产芯片和操作系统,提供计算机系统软硬件适配服务,推动国产软硬件生态体系建设。同时,研究院致力于芯片研制、软硬件设计、信息通信、卫星导航等领域高层次技术人才的培养,努力打造一支高水平的科研队伍。 PK体系技术协同创新中心是天津先进技术研究院联合国内知名高校组建的研发平台。中心以国家重大战略需求为牵引,深耕自主CPU和操作系统,围绕高性能计算、量子计算、微电子技术、人工智能等方向开展协同创新和应用推广,促进信创产业高速发展。智能泛在感知协同创新中心是天津先进技术研究院联合国内知名高校组建的研发平台。中心围绕感知芯片与器件、空间环境探测、空间信息系统等方向开展技术研发。在高性能地理信息系统、智能物联网、反无人机系统等领域开展协同创新和成果转化。
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