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CPU设计工程师

3.5-6.5万
  • 北京石景山区
  • 5-10年
  • 本科
  • 全职
  • 招2人

职位描述

微电子Verilog HDLCPU电子/半导体/集成电路
职位描述:
作为进迭时空CPU架构与开发团队的一员,你会参与面向多种应用场景的自研RISC-V处理器内核的建模、微架构设计与实现。
  1. 探索最前沿的RISC-V发展与趋势,包括RVI社区的进展、学术和工业界的成果、客户需求的变化与趋势,以及业界优秀的工程实践方法;
  2. 研究和归纳主流应用和benchmark程序的特性,通过建模、仿真和原型验证等方法分析性能瓶颈的关键因素,主导微架构的创新、优化与设计;
  3. 负责进迭时空RISC-V处理器内核新feature的微架构定义和RTL设计,参与从微架构到RTL级实现的完整流程;
  4. 提高进迭时空RISC-V处理器内核的功耗,性能和面积(PPA)指标。
职位要求:(满足任意一项 )
  1. 计算机系统结构,计算机、微电子专业、电路与系统、通信、人工智能等相关专业,计算机体系结构或微电子方向有理论基础扎实,具有一定工程和编码能力,同时具备研究与创新能力;
  2. 熟悉RISC-V(或Arm)通用处理器指令集与微架构,cache算法与微架构,分支预测算法与微架构等,有相关经验优先;
  3. 熟悉业界常用的片上互联NoC技术和片间互联协议,对存储介质有一定的研究,熟悉多核处理器Cache原理、结构及数据一致性;
  4. 熟悉Gem5或其他微架构仿真器,有建模和仿真经验者优先;
  5. 熟悉硬件模块的设计(Verilog, SystemVerilog,Chisel等),有CPU或DSP处理器设计或验证经验优先。
备选软技能描述:
好奇心驱动力,良好的创新能力,追求工作到极致,好的团队协作能力。
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工作地点

北京石景山区金安中海财富中心B座3层B022

职位发布者

应女士/人事

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公司Logo进迭时空(杭州)科技有限公司
进迭时空是由一批国内知名半导体企业的资深经营者和技术专家共同发起并创建的半导体创新企业。企业的创始人及其他联合创始人均毕业于国内外知名高校,并长期在国际/国内知名半导体企业担任核心技术/经营管理者。未来是智能时代,算力将成为智能时代最重要的生产力。公司致力于成为智能时代的算力基石,以芯片为载体为数字化与智能化时代提供普惠的算力;同时,公司希望经过20年的长期努力,成长为世界级的计算巨头。在最合适的年纪给梦想插上翅膀,在聚光灯下的芯片赛道上一展才华,只要你有信仰,梦想,just do it!一起为世界级的计算巨头打上你的烙印。公司福利:1.培训发展:入职培训、内部分享交流会、外部大咖培训等;2.发展通道:每年提供晋升机会,竞聘机会等;3.六险一金:全额缴纳社会保险及住房公积金,住房公积金比例12%;缴纳商业医保4.带薪假期:法定年假及额外福利年假;带薪病假;5.节日福利:节日伴手礼样样有(粽子、月饼、年货等);6.每年定期体检;7.团建活动:免费下午茶,生日会,零食水果小蛋糕,春游秋游、聚餐、卡拉OK等,端午节圣诞节等节日趣味小活动,每年旅游超多乐趣。
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