400-885-9898
职位描述
Verilog HDL
1.熟悉Verilog\VHDL硬件描述语言，有良好的代码风格；
2.熟悉Xilinx或者Altera开发环境；
3.熟悉常用ip使用；
4.有图像开发经验和高速接口开发经验优先。
福利待遇：五险一金、双休、高温假、年假、十三薪、过节福利、国家法定节假日
工作地点
西安高新技术产业开发区旺座现代城D座2904
认证资质
营业执照信息
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