400-885-9898
职位描述
模块级验证系统级验证Verilog HDLSV语言C语言VCSQuestasimNCUVM验证方法学自动化验证脚本开发覆盖率分析
【工作职责】：
1. 负责芯片模块级/系统级的功能验证全流程，包括验证方案设计、用例开发及仿真执行。
2. 基于UVM验证方法学独立搭建可复用的验证平台，覆盖功能仿真、时序仿真等关键环节。
3. 主导验证过程中的问题定位与调试，输出完整的验证报告及覆盖率分析，支撑芯片流片决策。
【任职要求】：
1. 本科及以上学历，电子工程、微电子、计算机科学等相关专业。
2. 精通Verilog/System Verilog硬件描述语言，熟练掌握UVM验证方法学，具备独立搭建验证平台的能力。
3. 熟悉芯片全流程验证（前仿真/后仿真），能熟练使用Qustasim/NCsim/VCS等主流仿真工具。
4. 掌握C/C++、Python、Makefile等脚本语言，具备自动化验证脚本开发能力。
5. 拥有已流片项目的仿真验证经验，能独立编写验证策划、用例、报告及覆盖率分析文件。
工作地点
未央区西安环普创新城A1
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信必优(深圳)信息技术有限公司
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职位发布者
武彦花/高级招聘专员
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